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Agilex(TM) 5 FPGA の外部メモリー・インターフェース設計



Agilex(TM) 5 FPGA の外部メモリーインターフェース(EMIF) は DDR4、LPDDR4、DDR5、LPDDR5 をサポートしており、それぞれ IP が提供されています。設計者は IP を利用することで、複雑なメモリー・インターフェースの設計作業を大幅に削減でき、迅速に製品開発を進めることが可能になります。また、サンプルデザイン、デバッグツールも提供されており、ユーザー回路を作成せずにインターフェースの評価、デバッグが可能です。
本セミナーでは、Agilex(TM) 5 FPGA EMIF IP の概要とパラメーター設定、注意すべきポイント、デバッグツールなどについてご紹介します。



日時
2025年6月6日 11:00-12:00
会場 オンラインセミナーでの開催
※下記URLより事前に接続テストを実施することができます。
https://zoom.us/test
定員 なし
準備 当日ご準備いただくもの
・オンラインセミナーを受講するPC
・インターネット接続のための環境
対象
・FPGA設計初心者の方
・メモリー・インターフェースに興味がある方
・Agilex(TM) 5の活用を考えているエンジニア
費用 無料
主催 株式会社マクニカ


アジェンダ

・EMIF IP の概要
・キャリブレーション
・ユーザー・インターフェース
・ピン配置
・IP のパラメーター設定
・サンプルデザインの生成
・デバッグツールキット
・まとめ

注意事項

フリーメールアドレスでのお申込み、学生の方、競合代理店や競合製品をお取り扱いの企業様、本セミナーへの参加がふさわしくないと当社が認める事情がある際は、参加をお断りさせていただく場合がございます。
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